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Cadence Allegro 16.6 PCB設計軟件操作100講速成實戰(zhàn)
入門級PCB工程師
能力要求:
能制作簡單的封裝,如DIP10等到;
掌握至少一種PCB設計軟件的基本操作,并能制訂簡單的布線線寬和間距等規(guī)則;
能對具有100個元件和200個網(wǎng)絡或以下PCB進行較合理和有序的布局和布線;
能在他人或自定規(guī)則下手動或自動布線并修改,達到100%布通并DRC完全通過;
具備基本的機械結(jié)構(gòu)和熱設計知識;
掌握雙面板走線的一些基本要求。
工作內(nèi)容:
簡單PCB的設計和修改(如結(jié)構(gòu)簡單的前面板、單片機小系統(tǒng)板等);
復雜PCB中規(guī)定部分的走線;
與自己設計PCB相關(guān)的調(diào)試;
寫相關(guān)的開發(fā)、調(diào)試日志。
工作職責:
對PCB中自己設計部分負責。
初級PCB工程師
能力要求:
能根據(jù)手冊和實物制作較復雜的封裝,如帶燈RJ-45座等,并保證外形、焊盤等尺寸完全正確(按實物測量至少保證可插入);
較熟悉掌握至少一種PCB設計軟件并能獨立或在指導下制訂較詳細的布線規(guī)則;
能對具有400個元件和1000個網(wǎng)絡或以下單、雙面和多層PCB進行較合理和有序的布局和布線,能在布局布線過程中隨時考慮到熱設計、結(jié)構(gòu)設計、電磁兼容性設計、美觀等方面的要求,自己不能確定時及時向更高級PCB工程師請教或共同探討;
能在他人或自定規(guī)則下熟練手動或自動布線并修改,達到100%布通并DRC完全通過,基本上不存在線寬瓶頸、內(nèi)層孤島等問題,布線過程中能看出少量原理設計上低級錯誤并提出,并能正確進行引腳和門交換,能正確修改網(wǎng)絡表和原理圖;
能正確導入、導出機械圖紙并基本看懂結(jié)構(gòu)尺寸要求;
能在他人所制定規(guī)則或指導下進行一些高速和模擬PCB設計并基本穩(wěn)定;
絲印標志清晰明了,能獨立完成出GERBER等設計輸出工作并校對;
具備基本的可制造性方面知識并用于實踐,所設計板子50%以上可用于生產(chǎn)。
工作內(nèi)容:
較復雜PCB的設計和修改(如調(diào)度機中除CPU板外的板,十六畫面分割器板等);
復雜PCB中規(guī)定部分的走線;
與自己設計PCB相關(guān)的調(diào)試;
對所有更低級PCB工程師的工作指導;
寫相關(guān)的開發(fā)、調(diào)試日志;
必要時(指自己一定時間內(nèi)暫時無相應的設計任務,或某一PCB設計工作時間緊迫,必須抽調(diào)或加強設計人員時,下同)妝任任意低級PCB工程師的工作。
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Cadence Allegro 16.6 PCB設計軟件操作100講速成實戰(zhàn)
旁路電容和抗信號混疊濾波器的使用
有關(guān)旁路電容的一個原則是:在電路中始終包含旁路電容。如果設計電路時,沒有加旁路電容,電源噪聲很可能使電路的精度達不到12位。
旁路電容
可在電路板上的如下兩個位置放置旁路電容:一個電容(10mF至100mF)放置在電源側(cè),另一個電容放置在每個有源器件(包括數(shù)字和模擬器件)旁邊。加在器件上旁路電容的值取決于使用的器件。如果器件的帶寬小于或等于1MHz,那么采用1mF的電容可以顯著降低引入的噪聲。如果器件的帶寬大于10MHz,0.1mF的電容可能比較合適。如果帶寬在這兩個頻率之間,可同時使用這兩種容值的電容,或使用其一。
電路板上的每個有源器件都需要一個旁路電容。旁路電容必須盡可能靠近器件的電源引腳放置,如圖5所示。如果一個器件使用了兩個旁路電容,容值小的電容要最靠近器件引腳。而且,旁路電容的引腳要盡量短。
抗信號混疊濾波器
請注意,圖1所示的電路中沒有抗信號混疊濾波器。正如數(shù)據(jù)所顯示,這一疏忽在電路中引起了噪聲問題。此電路板中,當在儀表放大器的輸出和A/D轉(zhuǎn)換器的輸入之間接入一個四階、10Hz抗信號混疊濾波器時,轉(zhuǎn)換響應的性能大為提高,如圖8所示。
模擬濾波可在模擬信號到達A/D轉(zhuǎn)換器之前,消除疊加在模擬信號上的噪聲,尤其是無關(guān)的噪聲尖峰。A/D轉(zhuǎn)換器將對出現(xiàn)在其輸入端的信號進行轉(zhuǎn)換,這種信號可能包括傳感器電壓信號或噪聲,抗信號混疊濾波器消除了轉(zhuǎn)換過程中的高頻噪聲。
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